时间:2022-06-03 05:35:45作者:大毛
半加器
a全加器 b全减器 c二选一电路 d偶校验电路
这里全加器不用门电路构成,而选用集成的双全加器74ls183.
实验5 组合逻辑电路(加法器)ppt
当~set为1,~reset为0的时候,q(x)为0,~q(x)为1 任务四 设计全加电路
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